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社区首页 >专栏 >《亚稳态两级同步器方案详解》存在笔误,勘正

《亚稳态两级同步器方案详解》存在笔误,勘正

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FPGA探索者
发布于 2022-05-26 07:42:36
发布于 2022-05-26 07:42:36
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文章被收录于专栏:FPGA探索者FPGA探索者

以下文章内容有笔误,配图无误:

文中所述的两级同步器,都是针对的单bit脉冲慢时钟快时钟的同步,有3处提及到快时钟到慢时钟的地方,均改成慢时钟到快时钟。

所有配图均无误,快慢时钟频率倍数关系无误。

具体三处错误更正:

第2和第5点所说的快时钟到慢时钟快时钟——>慢时钟都改成:慢时钟到快时钟,文字有误,所有配图均无误。

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原始发表:2022-04-13,如有侵权请联系 cloudcommunity@tencent.com 删除

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