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2
回答
NUMA:如何检查分配了C++数组
的
内存
的
哪一部分?
、
、
、
我有一个2
CPU
和64 of
的
服务器
,
每个
CPU
32 of。 // put the thread at i-th
CPU
, using pthread_setaffinity_np
浏览 22
提问于2013-11-06
得票数 2
回答已采纳
1
回答
“锁”操作码前缀
是否
由于“缓存
一致
性机制”而无效?
、
、
、
、
英特尔手册上说: ..。
CPU
缓存总是打开
的
,所有应用程序访问
的
内存
都是可缓存
的
,因此缓存
一致
性机制始终保持警惕,以保护存储在共享
内存
中
的
浏览 1
提问于2016-03-25
得票数 1
回答已采纳
1
回答
Linux中
的
物理位置感知用户空间
内存
分配(
内存
控制器亲和性)
、
、
、
、
我想测试在基于64位、2
CPU
、16核Intel Xeon 5500
CPU
的
服务器
上,如果从不同
的
物理
CPU
和不同
的
嵌入式
内存
控制器分配和访问
内存
,可能会出现性能差异。(戴尔T710) 查看供应商白皮书,我可以看到
每个
物理
CPU
都有3个独立
的
内存
控制器。还有2个物理
CPU
,总共有6个并行
内存
控制器。我想知道同一控制器、同一物
浏览 1
提问于2010-08-05
得票数 1
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1
回答
查询kubernetes度量-
服务器
度量值
、
、
我正在使用度量-
服务器
()从kubernetes集群中
的
容器中收集核心度量。
浏览 0
提问于2019-04-15
得票数 2
1
回答
在具有多个(物理)
CPU
的
系统上
的
多线程进程中,线程调度是如何处理
的
?
、
、
、
、
-染料之间
的
缓存
一致
性是可能
的
,但速度比预期
的
要慢。假设: 我有一个多线程
的
单进程服务.类似的东西。它可以有效地利用多个核,并以一种通常避免
cpu</e
浏览 6
提问于2014-03-09
得票数 3
2
回答
GPU上
的
相干
内存
是什么?
、
、
、
在“不连贯”和“连贯”
的
记忆中,我一次也没有失足。 与图形编程有关,我一直在寻找一个简单而清晰
的
解释,但大部分找到了类型
的
“硬核心”文件。我很乐意收到外行人关于GPU体系结构上
的
相干
内存
实际上是什么,以及它与其他(可能不是相干
的
)
内存
类型
的
比较
的
风格答案。
浏览 4
提问于2016-03-26
得票数 24
回答已采纳
3
回答
内存
障碍强制缓存
一致
性?
、
、
、
、
我当时正在读,对@eran
的
回答很感兴趣: 仅在单个内核上使用易失性就足够了,所有线程都使用相同
的
缓存。在多核上,如果在一个内核上调用stop(),而在另一个内核上执行run(),则可能需要一段时间才能使
CPU
缓存同步,这意味着两个内核可能会看到isRunning_
的
两个不同视图。如果使用同步机制,它们将确保所有缓存都得到相同
的
值,代价是使程序延迟一段时间。性能或正确性对您来说
是否
更重要,取决于您
的
实际需求。我花了一个多小时寻找一些语句,这些语句说同步原语会强制缓存<
浏览 8
提问于2015-06-20
得票数 10
回答已采纳
5
回答
EC2实例运行速度非常慢
、
、
、
、
Tomcat和MySQL已经在上面安装和部署了1个月
的
java web应用。它在近一个月
的
时间里运行得很好,性能也很好,但现在我
的
应用程序响应非常慢。另外,需要注意
的
是:早些时候我通过PuTTY登录我
的
Ubuntu
服务器
时,速度很快,但现在即使我输入Ubuntu密码也要花时间。 有什么解决方案吗?
浏览 1
提问于2015-08-27
得票数 6
1
回答
当多个GPU由独立
的
中央处理器进程控制时,即使存在足够
的
内存
,cudaMallocPitch也会失败
、
、
、
)
的
整个PC
服务器
的
一部分时,我得到'out of memory‘错误。
每个
GPU都由一个专用
的
CPU
线程控制,该线程在开始运行时使用正确
的
设备索引调用cudaSetDevice。我
的
图像大小是10000个列和7096行。
每个
像素都是1B (灰度)。当我将我<
浏览 63
提问于2017-09-30
得票数 -3
1
回答
在多个套接字
服务器
中应该使用多少个infiniband适配器?
、
、
双插槽主板
是否
应该为
每个
CPU
配备一个无限带适配器?也就是说,如果有两个infiniband带适配器,
每个
CPU
的
PCIe插槽中有一个。 这会消除经过QPI
的
信号吗?还是信号通过QPI
的
时间是疏忽
的
(因此可以使用一个适配器)?
浏览 0
提问于2016-09-15
得票数 2
1
回答
具有“侵略性”易失性语义
的
C和C++编译器
、
、
、
、
是否
有任何C或C++编译器为volatile变量实现“积极
的
”
内存
一致
性模型?所谓“咄咄逼人”
的
一致
性模型,我
的
意思是在生成
的
代码中伴随着对volatile变量
的
所有写入,并设置
内存
屏障。这是C或C++编译器在IA64 (Itanium)平台上
的
惯常行为。那x86呢?
是否
有编译器在x86平台上实现(或可以配置为实现)类似于Itanium
的
方法来处理x86变量?编辑
浏览 2
提问于2012-06-27
得票数 12
回答已采纳
1
回答
MS
一致
性检查
的
缓慢性能
、
我有一个带有8TB卷
的
文件
服务器
,MS正在对其进行
一致
性检查,它现在运行了16个小时,通过该卷运行
的
时间可能还不到30%。为什么这么慢?我
的
MS数据库备份(几百GBs)是在一瞬间完成
的
。我
的
DPM
服务器
有32 24
内存
和2*四核2.4Ghz,附带有24个磁盘
的
DAS。我
的
文件
服务器
有4GB
内存
和2*四核2.4Ghz,有11个本地磁盘,
每个
1TB配
浏览 0
提问于2013-01-05
得票数 3
回答已采纳
1
回答
Java volatile关键字怎么来保证 保证可见性、有序性
的
,为啥保证不了原子性?
浏览 201
提问于2021-08-31
回答已采纳
3
回答
使用正确数量
的
DIMMS以获得最佳
内存
性能Intel Xeon可伸缩
cpu
、
、
、
我试图理解所谓
的
平衡
内存
配置。对于来自英特尔
的
最新
CPU
,2018年1月,例如Xeon 8180和Xeon 6154,
每个
CPU
套接字应该使用多少DIMMS才能获得最佳
的
内存
性能?我不知道这
是否
值得进一步讨论,但就目前而言,由于定价,我不需要超过768 if
的
系统RAM, 对于RDIMM
的
选择,
每个
DIMM有8gb或16 GB或32 GB,
每个
cpu</e
浏览 0
提问于2018-01-23
得票数 4
1
回答
分析(性能和
内存
) .net应用程序指南
、
、
、
到目前为止,我
必须
在一个由客户端
服务器
架构组成
的
.net连接系统上工作。
服务器
由托管为windows服务
的
服务器
wcf服务和asp.net mvc 2应用程序组成。客户端是一个wpf应用程序。还有其他正在运行
的
windows服务在客户端和
服务器
之间执行同步。(
浏览 0
提问于2011-04-19
得票数 0
1
回答
如何测量OpenGL中
的
峰值
内存
带宽?
、
、
、
只是想知道我应该期望什么样
的
速度,我一直在尝试在全局
内存
和着色器之间进行基准测试,而不是依赖于GPU规格表。然而,我不能接近理论上
的
最大值。实际上,我
的
误差是50
的
1倍。这是我
的
三种方法(1.使用image_load_store
的
顶点着色器,2.使用无绑定图形
的
顶点着色器,3.使用无绑定图形
的
计算着色器):#include调用中变成了非常驻
的</e
浏览 83
提问于2015-06-30
得票数 18
1
回答
Intel Xeon上
的
NUMA :
内存
区域
必须
具有相同
的
大小吗?
、
我想知道Intel Xeon平台上
每个
处理器
的
NUMA区域
是否
必须
具有相同
的
大小,这意味着
每个
CPU
必须
连接相同数量
的
RAM,以及
是否
必须
或应该使用所有提供
的
内存
条。
浏览 0
提问于2015-07-22
得票数 1
13
回答
后缀性能
、
、
负载非常高,但在
cpu
和
内存
负载方面却不多。有谁在类似的情况下知道如何消除瓶颈吗?我不得不假设瓶颈是磁盘。只是更新一下,下面是iostat
的
样子: 0.00 0.001.49 22.28 72.28 42.57 629.70 1041.58 14.55 135.56
浏览 0
提问于2009-07-09
得票数 12
1
回答
共享
内存
IPC (和其他IPC)如何与多
CPU
工作?
、
我正在研究一个只有一个共享
内存
区域和一些GPIO/IRQ连接
的
2个
CPU
的
体系结构。它们是完全分开
的
,因此它们不共享任何缓存。但是,该计划是让共享
内存
中
的
相同Linux操作系统映像同时执行。我想知道IPC机制(如共享
内存
、信号等)将如何工作?因为这两个
CPU
是从同一个RAM中执行
的
,所以只要这些机制保持在RAM中,那么当一个
CPU
检查共享
内存
区域
的
状态时
浏览 3
提问于2012-10-04
得票数 1
1
回答
如何理解“形式内核
内存
排序模型”中
的
limus测试#5?
、
、
、
由于2)是在1之后有序
的
,所以观察r1 == 0是不可能
的
。给出
的
解释是,对b == 2
的
观察并不意味着3)是在2之后被排序
的
。相反,有可能是由一只哈特先前发出
的
内存
写入覆盖另一哈特稍后发出
的
内存
写入。
的
第71-72页展示了一种可以实现这一点
的
机制. 每次
浏览 4
提问于2020-01-04
得票数 3
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