单口 RAM（Single RAM）、双口 RAM（Dual RAM）、简单双口 RAM（Simple-Dual RAM）、真双口 RAM（True-Dual RAM）有什么不同？
FPGA/数字IC笔试面试，无线通信物理层及数字信号处理，Verilog和Vivado HLS高层次综合技术。
跨时钟域处理是 FPGA 设计中经常遇到的问题，而如何处理好跨时钟域间的数据，可以说是每个FPGA初学者的必修课。如果是还在校生，跨时钟域处理也是面试中经常常被问到的一个问题。
本站点博客将逐步迁移至http://ninghechuanblogs.cn/ 本篇要分享的是基于Xilinx FPGA的视频图像采集系统，使用摄像头采集图像数据，并没有用到SDRAM/DDR。这个工程使用的是OV7670 30w像素摄像头，用双口RAM做存储，显示窗口为320x240，而且都知道7670的显示效果也不怎么样，这是一次偶然的机会我得到的资源，便在basys3、zybo、国产FPGA PGT180H上移植成功，总体的显示效果也是可能达到7670应有的标准，7670可以说是最
FPGA调试本身就是挺辛苦的一件事情，尤其是在刚开始调试FPGA的时候，无论培训的时候如何强调一些注意事项，如跨时钟域问题，如接口问题，以及RAM读写冲突问题，但一旦做起项目来，每每还是有同学必须要亲自往这些坑里面跳一次才真正懂得这些BUG的含义。
动机在先前的文章中已经说的很清楚了，现在直接开干，下面 Step by Step 的详细介绍 ESXi 的安装以及 LEDE、iKuai、Win7 等虚拟机的安装及使用。
CDC（Clock Domain Conversion）跨时钟域分单bit和多bit传输，其中：
经典电路设计是数字IC设计里基础中的基础，盖大房子的第一部是打造结实可靠的地基，每一篇笔者都会分门别类给出设计原理、设计方法、verilog代码、Testbench、仿真波形。然而实际的数字IC设计过程中考虑的问题远多于此，通过本系列希望大家对数字IC中一些经典电路的设计有初步入门了解。能力有限，纰漏难免，欢迎大家交流指正。快速导航链接如下：
两家FPGA的区别本人认为有两方面吧：1.基本逻辑资源；2.内部基本架构。（也可以看成一方面吧）
#4KB的内部ROM（在8051中，程序和一些表格数据是存放在ROM之中的，我们又把ROM称为程序存储器）
万年历是采用数字电路实现对时、分、秒等信息进行数字显示的计时装置。广泛用于个人、家庭，车站，码头办公室等公共场所，成为人们日常生活中不可少的必需品，由于数字集成电路的发展和石英晶体振荡器的广泛应用，使得数字钟的精度，远远超过老式钟表，钟表的数字化给人们生产生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能。诸如定时自动报警、按时自动打铃、时间程序自动控制、定时广播、自动起闭路灯、定时开关烘箱、通断动力设备、甚至各种定时电气的自动启用等，但是所有这些，都是以钟表数字化为基础的。因此，研究万年历及扩大其应用，有着非常现实的意义。
在现在的数据采集分析系统中，随着采集数据的速度剧增，每次都对这些庞大的数据量直接进行分析，这将会占用很多的CPU，使得CPU不能及时的去做其它的事情。我们可以在传输这些数据的时候提供适当的通道，建立一个缓冲电路，来实现数据流的无缝缓存和处理，提高系统的处理速度和性能。
大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。
假定手头只有若干 8Kx1位的SRAM芯片。首先需要使用2片该芯片，把这2片芯片连接为类似1片8Kx2位的芯片
市面上有许多嵌入式GUI库可供选择，包括开源GUI库和闭源GUI库，开源GUI库：LVGL，EmWin等；闭源GUI库：TouchGFX，柿饼GUI等。
直方图操作（二）之统计电路 在实际的图像中，连续的像素点灰度值为相同值的情况非常常见，如果每来一个像素都对双口RAM进行一次寻址和写操作，显然降低了统计效率而提高了功耗。本文中给出一种优化的统计方式：
https://blog.csdn.net/qq_45634652/article/details/138034081?spm=1001.2014.3001.5502
第一章 硬件设计与原理 以AT89C51单片机为核心，起着控制作用。系统包括数码管显示电路、复位电路、时钟电路、发光二级管电路和按键电路。设计思路分为六个模块：复位电路、晶振电路模块、AT89C51、数码管显示电路、发光二级管电路和按键电路这六个模块。
VS1053是一款硬件编解码的音频芯片，提供SPI接口和IIS接口两种通信协议，这篇文章是介绍在Linux下如果模拟SPI时序来操作VS1053完成录音、播放音频歌曲功能。但是没有注册标准的音频驱动，没有对接音频框架，只是在驱动层完成VS1053的直接控制，本篇的重点主要是介绍如何初始化开发板的GPIO口，使用Linux的延时函数，模拟SPI时序，代码写了两种版本，一种是直接通过ioremap直接映射GPIO口地址，完成配置，一种是直接调用官方内核提供的库函数接口，完成GPIO口初始化，控制。
描述: 本章以物联网以及工业控制入门学习的朋友为主，针对微控制器四大平台的一个概览，简单讲讲这些平台都有什么样的特点，能胜任什么样的任务，以及未来这些平台的发展趋势，最后谈谈学习这四大平台的切入点。
<iframe name="ifd" src="https://mnifdv.cn/resource/cnblogs/LearnCH582M" frameborder="0" scrolling="auto" width="100%" height="1500"></iframe> 实物图 板载说明: ①主控芯片: CH582M ②外设接口: USB通信下载口, 串口(USART1,通信下载口), 板载蓝牙天线 ③主要功能: 蓝牙5.1 ,双路USB外设 开发单片机
<iframe name="ifd" src="https://mnifdv.cn/resource/cnblogs/LearnCH582M" frameborder="0" scrolling="auto" width="100%" height="1500"></iframe>
（1）单端口RAM 模式 单端口RAM的模型如图所示，只有一个时钟源CLK，WE为写使能信号，EN为单口RAM使能信号，SSR为清零信号，ADDR为地址信号，DI和DO分别为写入和读出数据信号。 单端口RAM模式支持非同时的读写操作。同时每个块RAM可以被分为两部分，分别实现两个独立的单端口RAM。需要注意的是，当要实现两个独立的单端口RAM模块时，首先要保证每个模块所占用的存储空间小于块RAM存储空间的1/2。在单端口RAM配置中，输出只在read-during-write模式有效，即只有在写操作
51单片是一种低功耗、高性能CMOS-8位微控制器，具有8K可编程Flash存储器，使得51系列单片机为众多嵌入式控制应用系统提供高灵活、超有效的解决方案。
这里的面积指一个设计消耗 FPGA/CPLD 的逻辑资源的数量，对于 FPGA 可以用消耗的 FF（触发器）和 LUT（查找表）来衡量，更一般的衡量方式可以用设计所占的等价逻辑门数。
微型计算机是由大规模集成电路组成的、体积较小的电子计算机。它是以微处理器为基础，配以内存储器及输入输出(I/O)接口电路和相应的辅助电路而构成的裸机。
这是我第一次在公众号发布评测视频，之前也没做过视频，从录视频、剪辑、渲染真的是太麻烦了，PR咱也不会，用的是剪映，初次尝试，以开发板评测为主题，一共剪了两段，一个是模仿iPhone7 快闪107秒产品发布视频，40秒的视频周末剪了一上午。第二段是完整的开发板开箱评测视频，14分钟时长，我嫌太麻烦，中间几乎没有剪辑，如果觉得视频内容太长，可以看下后面的文字评测内容，要比视频介绍更详细。 初次录视频，大家多多支持。 视频1：开发板评测快闪 http://mpvideo.qpic.cn/0bc3xiaas
产品研发需要几步？硬件设计、驱动开发、应用编写、生产制造？基于这几款网关，仅需1步即可上线！
设计一个双端口的RAM，具有独立的读写时钟，独立读写地址和数据端口，具有复位功能，并具有读和写的使能信号。
Block RAM与Distributed RAM，简称为BRAM与DRAM， 要搞清楚两者的区别首先要了解FPGA的结构：
每次打开 Linux PC 时，它都会经历一系列阶段，然后最终显示提示输入用户名或密码的登录屏幕。每个 Linux 发行版在典型的启动过程中都会经历 4 个不同的阶段。 每次打开 Linux PC 时，它都会经历一系列阶段，然后最终显示提示输入用户名或密码的登录屏幕。每个 Linux 发行版在典型的启动过程中都会经历 4 个不同的阶段。 用户登录提示 在本指南中，我们将重点介绍 Linux 操作系统从开机到登录的各个步骤。请注意，本指南仅考虑了当前使用的GRUB2引导加载程序和systemdinit 绝
测试方法：使用TestCenter向被测板子上的千兆以太网口打流，在FPGA内部通过自回环从源端口返回给TestCenter，通过看TestCenter控制界面上显示结果判断自回环是否正确。
FIFO存储器 FIFO是英文First In First Out 的缩写，是一种先进先出的数据缓存器。
（4）说明DFF2和DFF4为什么采用负沿采样？若采用正沿，会存在何种风险？（3分）
具有两套地址总线，一套用于读数据，一套用于写数据，二者可分别独立操作。下面给出一个128× 8 位双口RAM 的Verilog HDL 设计实例。 module ram_double( q,addr_in,addr_out,d,we,clk1,clk2 ); output [7:0]q; input [7:0]d; input [6:0]addr_in; input [6:0]addr_out; input we,clk1,clk2; reg [6:0]addr_out_reg; r
主持人按下抢答按键后，进入抢答模式，8位选手开始抢答，数码管显示抢答成功的选手号码，主持人按键再次按下后复位。
掌握 51 汇编语言设计和调试方法 掌握 protues 软件平台及实验箱的操作步骤
乒乓操作的处理流程为：输入数据流通过“输入数据选择单元”将数据流等时分配到两个数据缓冲区，数据缓冲模块可以为任何存储模块，比较常用的存储单元为双口 RAM(DPRAM)、单口 RAM(SPRAM)、FIFO 等。
创龙科技TLT507-EVM 是一款基于全志科技T507-H 处理器设计的4 核ARM Cortex-A53 国产工业评估板， 主频高达 1.416GHz ，由核心板和评估底板组成。核心板 CPU 、ROM、RAM、电源、晶振等所有器件均采用国产工业级方案， 国产化率 100% 。同时， 评估底板大部分元器件亦采用国产工业级方案。核心板经过专业的 PCB Layout 和高低温测试验证，稳定可靠，可满足各种工业应用环境。
本次测试板卡是创龙科技旗下，一款基于全志科技A40i开发板，其接口资源丰富，可引出双路网口、双路CAN、双路USB、双路RS485等通信接口，板载Bluetooth、WIFI、4G（选配）模块，同时引出MIPI LCD、LVDS LCD、TFT LCD、HDMI OUT、CVBS OUT、CAMERA、LINE IN、H/P OUT等音视频多媒体接口，支持双屏异显、1080P@45fps H.264视频硬件编码、1080P@60fps H.264视频硬件解码，并支持SATA大容量存储接口。
计算机系统的运转是系统中软硬件共同努力的结果，没有硬件的软件是空中楼阁，而没有软件的硬件则只是一堆废铁。
创龙科技TL5728F-EVM是一款基于TI Sitara系列AM5728（双核ARM Cortex-A15 +浮点双核DSP C66x） + Xilinx Artix-7 FPGA处理器设计的高端异构多核评估板，由核心板与评估底板组成。AM5728与Artix-7在核心板内部通过GPMC、I2C通信总线连接，在评估底板通过PCIe通信总线连接。核心板经过专业的PCB Layout和高低温测试验证，稳定可靠，可满足各种工业应用环境。
创龙科技SOM-TL62x是一款基于TI Sitara系列AM62x单/双/四核ARM Cortex-A53 + 单核ARM Cortex-M4F异构多核处理器设计的高性能低功耗工业级核心板，通过工业级B2B连接器引出2x Ethernet、9x UART、3x CAN-FD、GPMC、2x USB 2.0、CSI、DISPLAY等接口。处理器ARM Cortex-A53(64-bit)主处理单元主频高达1.4GHz，ARM Cortex-M4F实时处理单元主频高达400MHz，采用16nm最新工艺，具有可与FPGA高速通信的GPMC并口，同时支持双屏异显、3D图形加速器。核心板经过专业的PCB Layout和高低温测试验证，稳定可靠，可满足各种工业应用环境。
推上看到有dalao分享蜗牛星际的车，作为伪“资深垃圾佬”自然不能错过，于是去咸鱼上收了一台。
整个嵌入式系统的加载启动任务完全交给Bootloader完成，它的主要任务是将内核映象从硬盘读到RAM中，然后跳转到内核入口启动内核（操作系统）！通俗来讲，Bootloader的作用就是初始化硬件，启动操作系统。
目前主流的FPGA仍是基于查找表技术的，已经远远超出了先前版本的基本性能，并且整合了常用功能（如RAM、时钟管理和DSP）的硬核（ASIC型）模块。如图1-1所示（注：图1-1只是一个示意图，实际上每一个系列的FPGA都有其相应的内部结构），FPGA芯片主要由6部分完成，分别为：可编程输入输出单元、基本可编程逻辑单元、完整的时钟管理、嵌入块式RAM、丰富的布线资源、内嵌的底层功能单元和内嵌专用硬件模块。
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