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1
回答
管理来自定制硬件的
中断
、
、
、
、
我正在为一个定制的硬件(基于Xilinx FPGA )开发一个驱动程序,并且在接收它发送的
中断
时遇到了困难。旧系统运行uCOS-II,只注册了
中断
ID94。当我在
Linux
中注册该
中断
时,即使我知道硬件正在发送信号,它也不会触发。 Image Type: ARM
Linux
Kernel
浏览 4
提问于2018-03-28
得票数 1
3
回答
zynq
上的嵌入式arm编译器?
、
、
、
、
我想在
Zynq
上设计一个基于
Linux
的固件,它可以支持在板上编译c程序,然后执行它。所以我需要一个用于arm架构的编译器,但是我怎么才能真正做到呢?做这件事真的可行吗?
浏览 2
提问于2015-04-27
得票数 1
1
回答
什么是FPGA逻辑的GUI控制的实用方法?
、
、
、
我有一块
Zynq
开发板(Z7020),在硬件核心上我运行的是
Linux
。我想要控制逻辑,我将编程到
Zynq
的FPGA部分,与一个GUI界面运行在硬件核心上,并显示在连接的触摸显示屏上。在选择选项或从GUI界面启动/停止任务时,是否仅向FPGA发送
中断
? 我如何将任务已完成的指示从FPGA返回到硬件核心,或者可能返回一些数据?
浏览 3
提问于2016-03-16
得票数 0
1
回答
在AMP(非对称多处理)模式下
使用
Zynq
、
、
在AMP模式下
使用
Zynq
的应用笔记有XAPP 1078和XAPP 1079等。提前感谢
浏览 3
提问于2015-11-17
得票数 1
2
回答
与Devfreq一起
使用
的
Zynq
时钟
、
、
、
我正在研究与devfreq电源管理一起
使用
的exynos4_bus.c驱动程序,以尝试为
Zynq
SoC上的外围设备开发类似的驱动程序。我现在正在查看arch\arm\mach-
zynq
\include\mach\
zynq
_soc.h,试图为
Zynq
设置找到一些等效的东西,但是有相当多的时钟正在定义中,所以我不确定应该设置哪个时钟。
浏览 5
提问于2013-03-24
得票数 0
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1
回答
交叉编译时发生CMake GTest致命错误(缺少stdlib.h)
、
、
、
/bin/arm-
linux
-musleabihf-gcc) set(CMAKE_FIND_ROOT_PATH /opt/
zy
浏览 5
提问于2019-05-31
得票数 1
1
回答
ARM Cortex-A9软件生成的
中断
只触发一次
、
、
我在
Zynq
7020中
使用
ARM Cortex-A9,在软件生成的
中断
方面有问题。当我在核心ARM1中生成一个SGI (写入ICDSGIR寄存器)时,只触发一次而不是一次,对ICDSGIR的多次写入不会触发
中断
。在
配置
中我可能错过了什么?
浏览 7
提问于2014-04-10
得票数 1
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2
回答
zynq
pl会导致内核崩溃吗?
、
、
、
我们的系统
使用
Xilinx
Zynq
soc。但是,我们没有修改内核代码,也根本没有
使用
驱动程序。那么,正如我们所想的,
Zynq
会导致内核崩溃吗?有没有办法证明这一点呢?
浏览 6
提问于2021-06-09
得票数 0
1
回答
wic和fitImage+Initramfs的循环依赖问题
、
我正在尝试建立SD卡的形象,
使用
wic在Yocto。我发现如果我用包initramfs启用了fitImage,它会触发错误。如果我禁用INITRAMFS_IMAGE,它可以正常工作。/meta-xilinx/meta-xilinx-bsp/recipes-kernel/
linux
/
linux
-xlnx_2018.3.bb:do_deploy (dependent Tasks ['
linux
-xlnx/meta-xilinx/meta-xilin
浏览 1
提问于2019-03-11
得票数 2
1
回答
Zynq
处理器采集的图像数据存储在
Zynq
的PS块的内存中的什么地方?这样我就可以
使用
AXI接口将其带到PL块
、
、
、
我
使用
的是
Zynq
board。现在,
使用
linux
编程,我对
Zynq
处理器的PS部分进行编程并捕获视频,现在我有了包含捕获的Image数据的imagebuffer变量。我想
使用
AXI接口将数据从PS带到PL部分,我可能会
使用
AXI_VDMA互连,问题是图像缓冲区存储在内存中的什么地方,这样我就可以把它带到
Zynq
中的PL部分。
浏览 27
提问于2014-04-10
得票数 3
1
回答
关于火箭核心的fsim verilog与Zedboard verilog代码的质疑
有人能解释一下从rocket核心的fsim目录(Top.DefaultFPGAConfig.v,
使用
提供的默认conf文件)生成的verilog代码和Zedboard文件夹(Top.DefaultFPGAConfig.v我正在尝试在virtex 7 FPGA上合成它,而不是基于
Zynq
的板,但只是希望能帮助我理解这两个源之间的不同之处。另外,有没有人合成了fsim verilog代码,并在FPGA (不基于
Zynq
)上的测试平台上运行它?
浏览 3
提问于2014-10-20
得票数 1
1
回答
RedPitaya hello world挂起了一块板子
、
、
、
、
通过命令进行位扫描并写入FPGA后:LED正常闪烁,但RedPitaya板上的
Linux
挂起。为什么会发生这种情况?
浏览 35
提问于2019-11-19
得票数 0
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2
回答
在
使用
u-boot启动时,zImage不会发生解压缩。
、
、
、
、
板引导与所有设置良好(不
使用
petalinux)。但我注意到内核不是解压缩的内核..。zImage和uImage。而我可以看到引导文件和petalinux的图像。tftpboot 0x3000000 zImage && tftpboot 0x2A00000 system.dtb && bootz 0x3000000 - 0x2A00000
Zynq
[2017-10-25 15:57:15[2017-10-25 15:57:22 Using
浏览 3
提问于2017-10-25
得票数 0
1
回答
如何在Xilinx中添加
linux
平台的lwip
库
、
、
、
、
我的问题是,如何将lwip
库
添加到工具Xilinx中,以便在嵌入式
linux
环境中
使用
它。我试了很多次,但总是存在调试问题。我从链接中添加了这个
库
,例如lwip-2.0.2谢谢你的建议
浏览 5
提问于2018-10-18
得票数 1
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1
回答
make[1]:*没有制定目标“
zynq
_xcomm_adv7511_deconfig”的规则
、
我试图编译一个内核映像,如教程中的这些步骤所定义的那样;Cloning into '
linux
Checking out files: 100% (38170/38170), done.> git checkout xcomm_
zynq
> # For AD-FMCOMMS2make
zynq
_
浏览 2
提问于2015-07-08
得票数 1
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1
回答
Vivado,将
中断
添加到自定义AXI Perh
、
、
、
我正在迁移到
使用
Vivado,并希望将interupt生成添加到我的自定义AXI perph中。在ISE中,我以前曾
使用
AR记录()中提供的一个模板完成此操作。我需要以类似的方式将
中断
信号端口和控制器IP添加到AXI perph中吗?到目前为止,我已经在
Zynq
系统上启用了Core0-nIRQ端口,我只是不知道从自定义AXI perh到这个端口的中间步骤。 相同的
浏览 2
提问于2013-12-08
得票数 3
3
回答
如何
使用
Vivado将Red Pitaya FPGA与服务器代码对接
、
、
、
、
我们的目标是将输入从GUI发送到服务器,然后服务器与FPGA连接,以产生一个信号,我将从示波器读取该信号(我
使用
Red Pitaya作为我的主板)。我目前已经制作了GUI,并且能够将数据发送到它成功接收的服务器(当服务器在红色火龙果上运行时),但是,我不确定如何
使用
Vivado 2019.1将服务器接收到的数据发送到我在框图中创建的特定输入。我的红色pitaya板通过以太网连接到我的PC,它有自己的IP地址,我用它在PuTTY中运行它的
linux
服务器。我
使用
gcc在PuTTY shell中运行服务器。 编辑:很抱歉我的模
浏览 6
提问于2019-08-20
得票数 0
1
回答
ISR (
中断
服务例程)中类似信号的同步
、
、
、
我有一个队列,当发生不同的
中断
时,会调用队列的put和put函数。在这种情况下,是否有办法防止种族状况?虽然我们不能在
中断
服务例程中等待信号量,但创建类似功能的最佳方法是什么?我们
使用
Zynq
的ARM-Cortex A5处理器来开发代码.
浏览 2
提问于2017-05-29
得票数 2
回答已采纳
1
回答
Petalinux在启动期间挂起
、
、
我正在尝试在zedboard上启动
linux
,并通过可编程逻辑监控所有的内存访问。我首先尝试
使用
起始地址0x40000000启动
linux
。我一直在上关注这篇文章。>
Zynq
>
Zynq
>
Zynq
> fatload mmc 0 0x3000000 uImage 4326032 bytes read in 255 ms (16.2Image Name:
浏览 5
提问于2020-10-01
得票数 1
1
回答
ARM A9 GIC
中断
完成顺序
、
阅读"ARM®Generic interrupt Controller Architecture version 1.0 Architecture Specification“时,我读到”对于嵌套
中断
,
中断
完成的顺序必须与
中断
确认的顺序相反。但是,我发现无论确认的顺序如何,当我
使用
活动
中断
的id写入ICCEOIR时,该
中断
都会变为非活动状态。我是在Xilinx
Zynq
-7000上这样做的。我应该在这个实现上期待这一点吗?
浏览 0
提问于2017-08-01
得票数 0
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