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AXI总线详解

本来是在写PCIe，怎么突然又出现AXI了？不要急，先看下PCIe涉及到的知识点（初版）： ? 其中AXI协议也是PCIe知识体量中的一部分，所以先花一部分篇幅把AXI知识总结一下，具体如下。 ?...整个AXI非常复杂，涉及到的知识点也非常多，通过上面的图谱也能清晰地看出。其中，AXI也是ZYNQ系统中比较重要的一部分。...· AMBA总线，熟悉ARM架构的朋友应该都大致了解， AMBA是ARM公司的注册商标。是一种用于片上系统（SoC）设计中功能块的连接和管理的开放标准片上互连规范。...它促进了具有总线结构及多控制器或组件的多核处理器设计开发。自成立以来，AMBA已广为应用，远远超出了微控制器设备领域。...为啥说AXI是AMBA的一部分，看看下面两个图就可以比较清晰的了解。 ? ? 最后，就是所有的知识点都可以在Xilinx官方找到相关文档的说明，这里提供一些，建议大家以官方文档为主，自行进行研究。

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AXI总线简介(二)

AXI协议是基于burst的，主机只给出突发传输的第一个字节的地址，从机必须计算突发传输后续的地址。突发传输不能跨4KB边界（防止突发跨越两个从机的边界，也限制了从机所需支持的地址自增数）。...AXI3只支持1~16次的突发传输（Burst_length=AxLEN[3:0]+1），AXI4扩展突发长度支持INCR突发类型为1~256次传输，对于其他的传输类型依然保持1~16次突发传输（Burst_Length...下图给出了5次突发传输，起始地址为0，每次传输为8bit，数据总线为32bit，突发类型为INCR。 ? 下图给出3次突发，起始地址为4，每次传输32bit，数据总线为64bit。 ?

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AXI总线知多少？

前言本文针对秋招面试高频问题: AXI总线进行总结学习； ---- 1.简介 AXI是个什么东西呢，它其实不属于Zynq，不属于Xilinx，而是属于ARM。...它是ARM最新的总线接口，以前叫做AMBA，从3.0以后就称为AXI了。...AXI（Advanced eXtensible Interface）是一种总线协议，该协议是ARM公司提出的AMBA3.0中最重要的部分，是一种面向高性能、高带宽、低延迟的片内总线。...AXI总线和接口的区别：总线是一种标准化接口，由数据线、地址线、控制线等构成，具有一定的强制性。接口是其物理实现，即在硬件上的分配。...在ZYNQ中，支持AXI-Lite，AXI4和AXI-Stream三种总线，但PS与PL之间的接口却只支持前两种，AXI-Stream只能在PL中实现，不能直接和PS相连，必须通过AXI-Lite或AXI4

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AXI总线简介（一）

AXI4.0-lite是AXI的简化版本，ACE4.0 是AXI缓存一致性扩展接口，AXI4.0-stream是ARM公司和Xilinx公司一起提出，主要用在FPGA进行以数据为主导的大量数据的传输应用...AXI协议是基于burst的传输，并且定义了5个独立的传输通道：读地址通道、读数据通道、写地址通道、写数据通道、写响应通道。...读数据通道：读数据通道承载着读数据和读响应信号包括数据总线（8/16/32/64/128/256/512/1024bit）和指示读传输完成的读响应信号。...写通道包括数据总线（8/16...1024bit）和字节线（用于指示8bit 数据信号的有效性）。写响应通道：“从”使用写响应通道对写传输进行响应。所有的写传输需要写响应通道的完成信号。...主机写地址，给出一次写突发传输的写地址 AWLEN 主机突发长度，给出突发传输的次数 AWSIZE 主机突发大小，给出每次突发传输的字节数 AWBURST 主机突发类型 AWLOCK 主机总线锁信号

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AXI总线详解-总线、接口以及协议

总线、接口和协议，这三个词常常被联系在一起，但是我们心里要明白他们的区别。总线是一组传输通道，是各种逻辑器件构成的传输数据的通道，一般由由数据线、地址线、控制线等构成。...再比如，只要百度一下串行和并行，就会出来很多类似“串行通信与并行通信”、“串行接口与并行接口”、“串行总线与并行总线”、“串行协议与并行协议”以及“串行传输与并行传输”等概念介绍，既有传输（通信）方式，...举个简单的例子，PCI总线说的是一组传输通道，而PCI接口是一种连接标准，两者之间的关系就是PCI接口的设备都要通过PCI总线来进行通信，而PCI总线上走的设备并不全是PCI接口的，像集成声卡，走的就是...PCI总线，但是没有走PCI接口。...OVER -END- 推荐阅读 AXI总线详解

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AXI接口协议详解-AXI总线、接口、协议

AXI 总线上面介绍了AMBA总线中的两种，下面看下我们的主角—AXI，在ZYNQ中有支持三种AXI总线，拥有三种AXI接口，当然用的都是AXI协议。...图4‑10 AXI主设备与从设备之间的通信从上图很容易看出，要通过AXI总线实现通信，我们需要一个主设备/上位机(Master)和一个从设备/下位机(Slave)，并通过AXI总线将其相连。...二、信号说明首先说AXI4总线和AXI4-Lite总线具有相同的组成部分：（1）读地址通道，包含ARVALID, ARADDR, ARREADY信号；（2）读数据通道，包含RVALID, RDATA...而AXI4-Stream总线的组成有：（1） ACLK信号：总线时钟，上升沿有效；（2） ARESETN信号：总线复位，低电平有效（3） TREADY信号：从机告诉主机做好传输准备；（4） TDATA...对于AXI4-Stream总线命名而言，除了总线时钟和总线复位，其他的信号线都是以T字母开头，后面跟上一个有意义的单词，看清这一点后，能帮助记忆每个信号线的意义。

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深入AXI4 总线实战：Hello AXI handshake

本文授权转发自知乎用户 ljgibbs 链接：https://www.zhihu.com/people/ljgibbs 本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。...当前我对 AXI总线的理解尚谈不上深入。但我希望通过一系列文章，让读者能和我一起深入探寻 AXI4。...欢迎来到深入 AXI4 总线的实战篇，系列第二篇文章中，我们将首先了解调用 AXI VIP 产生激励与响应的方法，并完成一个小目标：实现三种情况下的握手信号。...是的，新的激励加上了 headbig 字段，这来自于深入 AXI4 总线系列文章的英文名：Headbig AXI4。...结语本文首先介绍了 AXI VIP 中产生传输事务的基本方法。基于 demo 修改了一个简单纯粹的例子，并基于这个例子观察到了握手信号。

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AXI总线详解-AXI4交换机制

大多数系统采用如下三种互连的方式之一： l共享地址和数据总线 l共享地址总线和多个数据总线 l拥有多个地址和数据总线的多层互联。在大多数系统中，地址的通道的带宽需求明显小于数据通道带宽的需求。...这种系统能在系统运行和复杂度之间实现良好平衡，而复杂度主要由于使用共享地址总线和多个数据总线互联方式去使能数据并行传输而导致的。...从上面可以看出，AXI 协议严格的讲是一个点对点的主从接口协议，当多个外设需要互相交互数据时，我们需要加入一个 AXI Interconnect 模块，也就是 AXI 互联矩阵，作用是提供将一个或多个...AXI 主设备连接到一个或多个 AXI 从设备的一种交换机制（有点类似于交换机里面的交换矩阵）。...Xilinx 在 Vivado 里我们提供了实现这种互联矩阵的 IP 核axi_interconnect，我们只要调用就可以。 ? 图4‑33 Vivado中IP核 AXI 协议支持乱序交易。

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AXI总线协议（一）、协议概述

AXI总线协议（一）、概述 AXI （高性能扩展总线接口，Advanced eXtensible Interface）是ARM AMBA 单片机总线系列中的一个协议，是计划用于高性能、高主频的系统设计的...除了地址和数据通道是分离的之外，读写数据的通道还是分开的，由此可以看出AXI总线的高速性。 5、可以指定多个需要处理的地址。...（二）、AXI总线类型自从2003年AXI1.0版本发布以后，目前的AXI版本是4.0，AXI接口类型有三种，即AXI4类型、AXI4-Lite类型，AXI4-Stream类型。...（三）、AXI架构 AXI协议规定一个AXI主机可以用写数据通道通过AXI总线互联将数据传送给一个AXI从机（或者通过读取数据通道从从机传送到主机），写数据传输会话会有一个额外的响应通道，但是读取时并没有...读还是写，地址和控制数据都是在数据的发送/接收之前：特别注意AXI互联（AXI Interconnect）：（1）、主机AXI从处理器系统和处理器时钟各自流向从机输出S00_AXI和S00_AXLK

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深入AXI4总线-架构

知乎用户ljgibbs授权转发本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。当前我对 AXI总线的理解尚谈不上深入。...[二] 架构五个独立通道 AXI4 总线的一大特征是它有 5 个独立的传输通道，这些通道都只支持单向传输。作为类比，SPI 总线有 2 条单向传输通道：MISO， MOSI。...无论是读写操作，AXI 总线支持，或者说基于突发传输（Burst Transaction）。...AXI 总线需要借助总线互联IP（ Interconnect ）来实现多对的的拓扑，结构如下图。...结语本文中我们了解了 AXI 总线的架构，它的五大通道以及各自的信号，最简单的读写操作流程以及AXI 总线的拓扑连接。

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观察 AXI4-Lite 总线信号

在《AXI-Lite 自定义IP》章节基础上，添加ila\vio等调试ip，完成后的BD如下图： ? 图4‑53 添加测试信号加载到SDK，并且在Vivado中连接到开发板。...Trigger Setup，点击“+”，选择 AXI_WVALID，双击添加。设置 Radix 为 B，触发条件 Value 为 1。 ? 图4‑54 添加信号设置触发位置为 512 ?...图4‑56 等待触发单击 SDK 中的运行按钮后， VIVADO 中 HW_ILA2 窗口采集到波形输出，可以看到 AXI 总线的工作时序。...SDK中 mian.c 程序功能是向 AXI4 总线写入 1~4，再从 AXI4 总线读数据，从上面对未修改直接封装的 IP 分析，可以读出的数据应等于写入的数据。

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深入AXI4总线- AXI4的兄弟协议

知乎用户ljgibbs授权转发本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。当前我对 AXI总线的理解尚谈不上深入。...声明2：AXI 总线是 ARM 公司的知识产权 ? 备注：下载手册可以到ARM官网搜AMBA ，需要注册 ARM 账号。...AXI4-Lite 说起来同样是弟弟，AXI4-Lite （为了方便，以下简称 Lite）应该算是亲弟，AXI4-Stream （Stream）那只能算表弟了，因为 AXI4-S 和他们没住在一本 specification...在去除地址概念后，Stream 协议主要面向高速的，大数据量的数据流传输，在今天的异构系统的数据传输中起着非常重要的作用，比如 Xilinx 的嵌入式系统 Zynq 中，Stream 总线是一项基础设施...transfer 的概念与 AXI4 中的同名概念完全相同，以一次 TREADY,TVALID 握手表示一次传输，每次 transfer 的数据传输量一般为数据总线的宽度。

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Xilinx FPGA AXI4总线（一）介绍【AXI4】【AXI4-Lite】【AXI-Stream】

从 FPGA 应用角度看看 AMBA 总线中的 AXI4 总线。...AMBA® AXI4（高级可扩展接口 4）是 ARM® 推出的第四代 AMBA 接口规范，AMBA（Advanced Microcontroller Bus Architecture）是片上总线标准，包含...AXI（Advanced eXtensible Interface），高性能、高带宽、低延迟片内总线。...AXI4 AXI4 协议是 AXI3 的升级，旨在提高多个主系统使用时的互连性能和互连利用率。...AXI4-Lite 接口主要特性为： （1）所有处理的突发长度为 1 （2）所有数据存取的大小等同于数据总线宽度 （3）不支持独占访问 ? 3.

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常见的AXI总线仲裁器概述

"最近的文章可能更偏向于找工作" SoC 设计广泛采用共享总线式的片上通信，其中的仲裁器是共享总线的关键技术之一。...AMBA AXI 总线协议以高性能、高频率的系统设计为目标，适合高带宽、低延迟的系统设计，可以达到高频率的操作而不需要复杂的总线桥，满足众多部件的接口要求，具备高度灵活的互联结构，并且向后兼容 AHB...AXI 协议的关键特性总结如下：多通道单向传输总线，将读/写地址、读数据、写数据、写响应信号在不同的通道中实现传输。基于 burst 传输，对于一次 burst 传输，只需要主机给出起始地址。...支持乱序传输（仅AXI3支持写乱序，AXI4已经取消），用 ID 来标识各个访问的归属。...除以上数据传输协议，AXI 协议还支持可选的低功耗操作。

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AXI协议详解-AMBA总线协议AHB、APB、AXI对比分析

，AXI4-lite，AXI4-stream，同时为满足复杂SOC的操作一致性引入ACE和ACE-lite协议，APB和ATB也同时得到增强，比如APB加入了PPROT和PSTRB，另外为改善总线数据传输引入...表 4‑10 几种AMBA总线的性能对比分析总线 AXI AHB APB 总线宽度 8, 16, 32, 64, 128, 256, 512, 1024 32, 64, 128, 256 8, 16,...AHB总线与AXI总线均适用于高性能、高带宽的SoC系统，但AXI具有更好的灵活性，而且能够读写通道并行发送，互不影响；更重要的是，AXI总线支持乱序传输，能够有效地利用总线的带宽，平衡内部系统。...因此SoC系统中，均以AXI总线为主总线，通过桥连接AHB总线与APB总线，这样能够增加SoC系统的灵活性，更加合理地把不同特征IP分配到总线上。...图4‑9 APB总线 OVER -END- 推荐阅读 AXI总线详解 AXI总线详解-总线、接口以及协议

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AXI总线详解-不同类型的DMA

DMA描述类型接口名称数据位宽接口类型功能描述关键特性AXI Centralized DMA control32AXI4-lite slaveCPU通过总线对ＤＭＡ内部的源地址寄存器、目的地址寄存器...a 兼容总线AXI4、AXI4-lite接口协议； b AXI4数据宽度支持32、64、128、256、512、1024； c AXI4-Stream 数据宽度支持8、16、32、64、128、256...a 兼容AXI4-lite AXI4、AXI4-Stream总线接口协议； b 可选的普通传输模式和S/G模式； c 数据宽度可至1024； d 可选AXI控制流和状态流； e 两通道是独立、全双工的...SlaveAXI4-Stream侧传入数据流的状态推荐阅读 AXI总线详解 AXI总线详解-总线、接口以及协议 AXI接口协议详解-AXI总线、接口、协议 AXI协议中的通道结构 AXI总线详解-...多时钟域和异步信号处理解决方案 AXI总线详解-AXI4交换机制计算机基础知识总结与操作系统.PDF IC技术圈期刊 2020年第09期 ZYNQ中DMA与AXI4总线-DMA简介

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AMBA、AHB、APB、AXI总线介绍及对比

System Bus) 高级系统总线----用的很少 APB (Advanced Peripheral Bus) 高级外围总线 AXI (Advanced eXtensible Interface...AHB是先进的高性能总线，AXI是先进的可扩展接口，APB是高级外围总线； AHB和APB都是单通道总线，不支持读写并行；而AXI是多通道总线，总共分为五个通道，能够实现读写并行； AHB和AXI都是多主.../从设备，且通过仲裁机制实现总线控制权的分配；而APB是单主设备多从设备，其主设备就是APB桥，不具有仲裁机制；在数据操作方面，AHB和AXI支持突发传输，APB不支持；此外，AXI支持数据的非对齐操作...，此特征大大提高了总线的利用率； AHB总线与AXI总线均适用于高性能、高带宽的SoC系统，但AXI具有更好的灵活性，而且能够读写通道并行发送，互不影响；更重要的是，AXI总线支持乱序传输，能够有效地利用总线的带宽...因此SoC系统中，均以AXI总线为主总线，通过桥连接AHB总线与APB总线，这样能够增加SoC系统的灵活性，更加合理地把不同特征IP分配到总线上；三、APB总线 APB是一种优化的，低功耗的，精简接口总线

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深入AXI4总线-传输事务结构

知乎用户ljgibbs授权转发本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。当前我对 AXI总线的理解尚谈不上深入。...声明2：AXI 总线是 ARM 公司的知识产权 ? 备注：下载手册可以到ARM官网搜AMBA ，需要注册 ARM 账号。...我们通过*深入AXI4总线（一）*了解到，双方握手信号就绪后，每个周期完成一次数据传输，因此 AXI Transfer 又被称为 AXI beat，一拍数据。...，从地址、数据以及回复总线上的传输事务结构，来了解 AXI 的整体传输事务结构传输事务结构（Transaction structure）读写地址结构在整个传输事务过程中，主机首先将接下来 burst...自然地，突发传输数据宽度不能超过数据总线本身的位宽。而当数据总线位宽大于突发传输宽度时，将根据协议的相关规定，将数据在部分数据线上传输。

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深入AXI4 总线实战：平台搭建

本文授权转发自知乎用户 ljgibbs 链接：https://www.zhihu.com/people/ljgibbs 本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。...当前我对 AXI总线的理解尚谈不上深入。但我希望通过一系列文章，让读者能和我一起深入探寻 AXI4。...欢迎来到深入 AXI4 总线的实战篇，在第一篇文章中，我们将搭建起我们的 AXI 仿真系统，帮助我们更好、更快地理解与运用 AXI 总线。...active sim_all_config ，run simulation，然后按照下图将总线添加到波形窗口中，注意是总线而不是单独的信号，不然就没有惊喜了。 ? 诶，然后惊喜来了，花里胡哨！...后续的实战篇中我们一方面继续通过示例工程学习 AXI VIP 的 API 调用。另一方面，也将结合理论篇的文章，对 AXI 总线进行一番实战。

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深入AXI4总线-握手机制

知乎用户ljgibbs授权转发本系列我想深入探寻 AXI4 总线。不过事情总是这样，不能我说想深入就深入。当前我对 AXI总线的理解尚谈不上深入。...声明2：AXI 总线是 ARM 公司的知识产权 ? 备注：下载手册可以到ARM官网搜AMBA ，需要注册 ARM 账号。...[一] 握手机制 VALID/READY 握手机制 AXI 总线共有 5 个独立的通道，分别为写地址、写数据、写回应、读地址、读数据通道。...module axi_src ......如果读者仅仅想了解 AXI 协议的使用，那么每篇文章的实现细节章节可以跳过。这个章节面向有实现 AXI 协议需求的读者。

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